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等效氧化层厚度(EOT):把电学厚度和物理厚度分开看

等效氧化层厚度(EOT)把栅介质的电容表示为:要得到相同单位面积电容,一层理想 SiO₂ 需要有多厚。对单层理想均匀薄膜,$EOT = t_{film}(\kappa_{SiO2}/\kappa_{film})$。实际栅堆叠可以有多层介质;把单层公式直接套给整叠膜,可能低估 EOT。理想串联电容模型中,每层介质各贡献一项:$EOT_{stack} = \sum_i t_i(\kappa_{SiO2}/\kappa_i)$。电学测量、界面和非理想效应决定真实器件与这个简化模型的接近程度 [P1]。

界面层为何重要

高介电常数薄膜在理想电容相近时,物理上可以比 SiO₂ 厚。较大的物理厚度可能降低某些直接隧穿路径,但 EOT 本身不能保证低漏电或可靠性:势垒性质、缺陷和界面也起作用。较低介电常数的薄界面层与高 k 层串联,同样贡献总 EOT。因此只改高 k 薄膜的效果,可能小于单层公式暗示的数值。

Process map · 流程地图

28nmGATE课程内

28nm Planar Flow 内所选的 4 步学习路线

查看热生长 SiO2 基线——串联堆叠中第一个 EOT 项的界面层。

真实步骤命名、逐层截面与原理讲解收录于 28nm Planar Flow 课程内,按账户权限解锁。

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双层理想化模型

两层理想化模型为 $EOT_{stack} = t_{IL}(\kappa_{SiO2}/\kappa_{IL}) + t_{high-k}(\kappa_{SiO2}/\kappa_{high-k})$。它是电容记账关系,不是目标膜厚或沉积配方。讨论高 k 金属栅膜栈时,必须同时评估界面质量与电容。计算得到更小的 EOT,也不能单独证明阈值电压、迁移率或寿命已改善。

决定 EOT 的栅介质堆叠

28nm 平面流程概览通向薄栅氧化、氮化、高 k 沉积与金属栅等具名栅模块步骤。学习路线沿用这些步骤已有的访问权限。可用它们识别哪些介质层进入电容模型;金属电极会影响栅行为,但在理想 EOT 求和中不是另一项介质厚度。步骤名称和图示不提供实测 EOT,也不证明界面质量。

热生长薄栅氧化层的真实截面
① 热氧化基线——串联堆叠中第一个 EOT 项的界面层
工程化界面上铪基高 k 介质的真实截面
② 高 k 膜就位——物理厚、电学薄;氮化与金属盖层由上文文字承接

与 28nm 平面课程同源渲染的真实截面——步骤命名、逐层原理与完整序列在课程内解锁。

使用数值前的条件

先说明数值是理想估算还是由电学数据提取、包含哪些介质层,以及是否考虑界面或寄生效应。二氧化铪介绍一种高 k 材料,栅氧化说明 SiO₂ 基线;任一种材料自身都不能指定完整栅堆叠。需要较短的术语定义,可对照 EOT 术语页;本文重点解释串联堆叠及其边界。

参考来源

[P1] 论文2017

Voltage and oxide thickness dependent tunneling current density and tunnel resistivity model: Application to high-k material HfO 2 based MOS devices

N. Maity, R. Maity, S. Baishya

DOI: 10.1016/J.SPMI.2017.07.022

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常见问题

什么是等效氧化层厚度(EOT)?
一层理想 SiO₂ 为得到与所评估介质相同的单位面积栅电容所需的厚度。报告 EOT 时应说明包含哪些介质层和测量假设。
多层栅堆叠的 EOT 怎么计算?
单层理想均匀薄膜的厚度乘以 SiO₂ 与该膜的介电常数之比;理想串联介质则把各层贡献相加。界面与测量效应会让真实器件偏离理想和式。
EOT 小就能保证低栅漏电吗?
不能。EOT 描述的是电容等效;漏电和可靠性还取决于物理厚度、势垒、缺陷与界面。

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